赛普拉斯半导体公司（Cypress Semiconductor）日前发布了最新版本的Warp®设计工具及设计环境。随着性能的提升，Warp 6.3版本 (Warp R6.3) 工具现在将可提供定时限制规范功能、更快的运行时间、改进的项目管理能力以及对赛普拉斯业界领先的CPLD（复杂可编程逻辑器件）系列支持能力的拓展。在全球范围内，Warp开发工具已设计完成了超过28000套软件，并已在150多所大学中得到使用，它已成为全球最受欢迎的基于HDL的CPLD开发工具之一。
Warp R6.3在开发过程的每一个步骤中都体现了强大的功能和易用的特点，并支持包括Delta39K™和Ultra37000™ CPLD 系列以及物理层 (PHY) 器件的可编程串行接口 (PSI™) 系列在内的所有赛普拉斯的可编程逻辑器件。Warp R6.3使设计人员能够为InfiniBand™、ESCON、光纤通道、千兆以太网和SMPTE 市场中的下一代通信系统开发出可编程物理层解决方案。
赛普拉斯负责CPLD的产品市场经理Rajiv Nema说到：“在一个全面的设计、合成和模拟环境中，最新推出的Warp R6.3设计工具将为CPLD提供完全的软件支持。Warp R6.3提供了相较而言昂贵许多的工具所提供的功能，使设计人员能够以最少的软件投资就可充分利用到可编程逻辑器件的优越性能和快速上市的优势。”
Warp R6.3功能
Warp R6.3增加了对所有Delta39K CPLD和可编程物理层器件规定定时限制的功能。所有版本的Warp开发工具的Warp前端都已对运行时间进行了卓有成效的改进，以此来加快其设计过程。在Warp专业版和企业版中，设计流程管理器也对编译时间进行了改进。赛普拉斯还增加了诸如报告文件书签等很有价值的功能，以此来改善项目管理能力并拓展对CPLD Delta39K系列的支持能力。
在个人计算机平台上，Warp R6.3还包括了Aldec公司出品的合成后定时模拟器Active-HDL Sim™ 的3.3版本和FSM（finite-state machine）编辑器Active-HDL FSM™。Active-HDL Sim是一个全功能的合成后VHDL定时模拟器，能支持VHDL模拟和为赛普拉斯器件所编译的Verilog文件。
价格和供货
赛普拉斯继续提供性价比很高的99美元的Warp R6.3版本，以及另外两个具有额外设计功能的版本：Warp专业版和Warp企业版。通过向客户提供免费技术支持和终身免费升级，赛普拉斯为客户带来了业界领先的价值.
Warp R6.3在开发过程的每一个步骤中都体现了强大的功能和易用的特点，并支持包括Delta39K™和Ultra37000™ CPLD 系列以及物理层 (PHY) 器件的可编程串行接口 (PSI™) 系列在内的所有赛普拉斯的可编程逻辑器件。Warp R6.3使设计人员能够为InfiniBand™、ESCON、光纤通道、千兆以太网和SMPTE 市场中的下一代通信系统开发出可编程物理层解决方案。
赛普拉斯负责CPLD的产品市场经理Rajiv Nema说到：“在一个全面的设计、合成和模拟环境中，最新推出的Warp R6.3设计工具将为CPLD提供完全的软件支持。Warp R6.3提供了相较而言昂贵许多的工具所提供的功能，使设计人员能够以最少的软件投资就可充分利用到可编程逻辑器件的优越性能和快速上市的优势。”
Warp R6.3功能
Warp R6.3增加了对所有Delta39K CPLD和可编程物理层器件规定定时限制的功能。所有版本的Warp开发工具的Warp前端都已对运行时间进行了卓有成效的改进，以此来加快其设计过程。在Warp专业版和企业版中，设计流程管理器也对编译时间进行了改进。赛普拉斯还增加了诸如报告文件书签等很有价值的功能，以此来改善项目管理能力并拓展对CPLD Delta39K系列的支持能力。
在个人计算机平台上，Warp R6.3还包括了Aldec公司出品的合成后定时模拟器Active-HDL Sim™ 的3.3版本和FSM（finite-state machine）编辑器Active-HDL FSM™。Active-HDL Sim是一个全功能的合成后VHDL定时模拟器，能支持VHDL模拟和为赛普拉斯器件所编译的Verilog文件。
价格和供货
赛普拉斯继续提供性价比很高的99美元的Warp R6.3版本，以及另外两个具有额外设计功能的版本：Warp专业版和Warp企业版。通过向客户提供免费技术支持和终身免费升级，赛普拉斯为客户带来了业界领先的价值.
